module sine_wave_gen(clk, data_out, clk_out);
    input clk;
     output clk_out;
    output reg [11:0] data_out;
    reg [11:0] sine [0:4096];
assign clk_out = clk;

    integer i;
initial begin
i = 0;
sine[ 0 ]= 2048 ;
sine[ 1 ]= 2050 ;
sine[ 2 ]= 2052 ;
sine[ 3 ]= 2054 ;
sine[ 4 ]= 2056 ;
sine[ 5 ]= 2058 ;
sine[ 6 ]= 2060 ;
sine[ 7 ]= 2062 ;
sine[ 8 ]= 2064 ;
sine[ 9 ]= 2066 ;
sine[ 10 ]= 2068 ;
sine[ 11 ]= 2070 ;
sine[ 12 ]= 2072 ;
sine[ 13 ]= 2074 ;
sine[ 14 ]= 2076 ;
sine[ 15 ]= 2078 ;
sine[ 16 ]= 2080 ;
sine[ 17 ]= 2082 ;
sine[ 18 ]= 2084 ;
sine[ 19 ]= 2086 ;
sine[ 20 ]= 2088 ;
sine[ 21 ]= 2090 ;
sine[ 22 ]= 2092 ;
sine[ 23 ]= 2094 ;
sine[ 24 ]= 2096 ;
sine[ 25 ]= 2098 ;
sine[ 26 ]= 2100 ;
sine[ 27 ]= 2102 ;
sine[ 28 ]= 2104 ;
sine[ 29 ]= 2106 ;
sine[ 30 ]= 2108 ;
sine[ 31 ]= 2110 ;
sine[ 32 ]= 2112 ;
sine[ 33 ]= 2114 ;
sine[ 34 ]= 2116 ;
sine[ 35 ]= 2118 ;
sine[ 36 ]= 2120 ;
sine[ 37 ]= 2122 ;
sine[ 38 ]= 2124 ;
sine[ 39 ]= 2126 ;
sine[ 40 ]= 2128 ;
sine[ 41 ]= 2130 ;
sine[ 42 ]= 2132 ;
sine[ 43 ]= 2134 ;
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sine[ 46 ]= 2140 ;
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sine[ 51 ]= 2150 ;
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sine[ 53 ]= 2154 ;
sine[ 54 ]= 2156 ;
sine[ 55 ]= 2158 ;
sine[ 56 ]= 2160 ;
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sine[ 76 ]= 2200 ;
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sine[ 111 ]= 2270 ;
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sine[ 129 ]= 2306 ;
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sine[ 133 ]= 2314 ;
sine[ 134 ]= 2316 ;
sine[ 135 ]= 2318 ;
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sine[ 138 ]= 2324 ;
sine[ 139 ]= 2326 ;
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sine[ 144 ]= 2336 ;
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sine[ 149 ]= 2346 ;
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sine[ 151 ]= 2350 ;
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sine[ 155 ]= 2358 ;
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    always@ (posedge clk)
    begin
        data_out = sine[i];
        i = i+ 1;
        if(i == 4096)
            i = 0;
    end

endmodule