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HDL Coder 2013

Generieren Verilog -und VHDL- Code für FPGA -und ASIC- Designs

HDL Coder ™ erzeugt tragbar, synthetisierbaren Verilog und VHDL ® ®-Code aus MATLAB ®-Funktionen , Simulink ®-Modellen und Stateflow ® -Charts. Die erzeugte HDL -Code kann für FPGA -Programmierung oder ASIC-Prototyping und Design verwendet werden.

http://www.mathworks.com/cmsimages/69945_wl_hdl_fig1_wl.jpg

HDL Coder bietet eine Workflow- Berater , die die Programmierung von Xilinx ® und Altera FPGAs ® automatisiert . Sie können HDL Architektur und Implementierung zu kontrollieren , markieren Sie kritische Pfade und erzeugen Hardware- Ressourcenauslastung Schätzungen. HDL Coder ermöglicht die Rückverfolgbarkeit zwischen Simulink- Modell und dem generierten Verilog und VHDL-Code , so dass die Code-Verifikation für High-Integrity Anwendungen Einhaltung DO -254 und anderen Standards.

Key Features

    Zielunabhängig , synthetisierbaren VHDL-und Verilog-Code
    Code-Generierung Unterstützung für MATLAB-Funktionen , System -Objekte und Simulink-Blöcke
    Mealy und Moore Zustandsautomaten und Steuerlogik Implementierungen mit Stateflow
    Workflow- Berater für die Programmierung von Xilinx und Altera Anwendung Platten
    Ressourcen- Sharing und Neutaktung für flächen Geschwindigkeit beim
    Code-zu- Modell -und Modell-zu- Code- Rückverfolgbarkeit für DO -254
    Legacy- Code-Integration


Komplette Produkt herunterladen:
(Lizenz enthalten)

http://linkn.es/HUY